Reporte de flip-flpo tipo dy jk

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ASIGNATURA: | SISTEMAS DIGITALES |
ALUMNO: | GILBERTO VEGA GONZÁLEZFRANCISCO SAMUEL YAÑEZ SANCHEZMARCO ANTONIO GONZALEZ ALARCON |
GRUPO: | IM - 601 | PARCIAL No. | 3 | TIPO | ORDINARIO |REPORTE DE LA PRACTICA FLIP-FLOP TIPO D Y J K

INTRODUCCIÓN

En el anterior reporte se presenta la forma en que funcionan los Flip-Flop tipo D yFlip-Flop tipo JK al llevarlo a cabo de manera física los problemas presentados y su funcionamiento principal estos dispositivos pueden ayudarnos a reducir circuitos de manera muy practica debido a sufuncionamiento y tipo de Flip-Flop correspondiente apoyándose de una señal de control de tiempo especial llamado reloj, la cual restringe los instantes en que podemos cambiar los estados de los elementos dememoria ya que las señales de salidas de los elementos de memoria son la señales de la entrada a la lógica combinatoria y viceversa.

DESARROLLO

El Flip-Flop tipo D opera de la misma manera quela versión SR este se liga con las compuertas cuando el reloj es bajo y se considera como un esclavo y lo hace cuando el reloj es alto podemos resumir que el comportamiento general de la salida Qasumirá el valor de D en la transición ascendente del reloj por tanto la ecuación característica para un Flip-Flop tipo D es simplemente Q = D. En la construcción de este lo primero que realizamos fueverificar su hoja de especificaciones para identificar cada uno de sus componentes teniendo ya conectado el integrado 555 en modo de reloj principalmente conectamos el reloj a las entradascorrespondientes del Flip-Flop posteriormente conectamos las salidas Q a las entradas D del Flip-Flop se nos presento el problema de no conectar las salidas de PS y CLR a cinco volts con lo que nos ocasionoproblemas y se desarrollaba el circuito adecuadamente solo hacia una secuencia y no se ciclaba es de suma importancia conectar estos a cinco volts en la figura anterior se demuestra como se verifico y...
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