Dispositivos Logicos Programables

Páginas: 10 (2395 palabras) Publicado: 23 de mayo de 2012
DISPOSITIVOS LOGICOS PROGRAMABLES

Introducción:

En el siguiente trabajo de investigación sobre los DISPOSITIVOS LOGICOS PROGRAMABLES sus ventajas y desventajas así como su aplicaciones.
En el desarrollo de la investigación se enfoca en 3 Dispositivos Lógicos Prográmables principales los cuales son PLD (Programmable Logic Device, Dispositivo lógico programable) el cual es un componenteelectrónico empleado para la fabricación de circuitos digitales, su clasificación, como   funciona. etc.,   Al igual que FPGA (Field Programmable Gate Array) el cual es un dispositivo semiconductor que contiene bloques de lógica cuya interconexión y funcionalidad puede ser configurada   mediante un lenguaje de descripción especializado y Un CPLD (del acrónimo inglés Complex Programmable Logic Device)es un dispositivo electrónico.
Los CPLD extienden el concepto de un PLD (del acrónimo inglés Programmable Logic Device) a un mayor nivel de integración ya que permite implementar sistemas más eficaces, ya que utilizan menor espacio, mejoran la fiabilidad del diseño, y reducen costos.

Dispositivos lógicos programables (PLD)
Un PLD (Programmable Logic Device, Dispositivo lógico programable) esun componente electrónico empleado para la fabricación de circuitos digitales. A diferencia de las puertas lógicas un PLD tiene una función indefinida. Antes de que un PLD pueda ser usado en un circuito este puede ser programado.
Un PLD está formado por una matriz de compuertas AND y puertas OR, que se pueden programar para conseguir funciones lógicas especificas. Existen cuatro tipos dedispositivos que se clasifican como PLD. Verilog es un lenguaje de descripción de hardware (HDL, del Inglés Hardware Description Language) usado para modelar sistemas electrónicos. El lenguaje, algunas veces llamado Verilog HDL, soporta el diseño, pruebae implementación de circuitos analógicos, digitales y de señal mixta a diferentes niveles de abstracción. Los sistemas pueden ser descritos: Nivel estructural empleando elementos de librería o bien elementos previamente creados, se realiza la interconexión de unos con otros. Sería similar a una captura esquem´atica donde la función del diseñadores instanciar bloques y conectarlos entre sí.
Nivelde comportamiento el diseñador describe la transferencia de información entre registros (nivel RTL: Register Transfer Level).
Estos dos niveles de descripción pueden mezclarse, dando lugar a los denominados diseños mixtos. Existen multitud de lenguajes HDL en el mercado (de hecho inicialmente cada fabricante disponía de su propio lenguaje), sin embargo la necesidad de unificación ha hecho que enla actualidad sólo existan dos grandes lenguajes: VHDL y Verilog . Ambos están acogidos a estándares IEEE (VHDL en 1987 y Verilog en 1995). Existen defensores y detractores de cada uno de ellos. Con carácter general se dice que es más fácil aprender Verilog al ser un lenguaje más compacto.
Posteriormente el advenimiento de los lenguajes de verificación de alto nivel como OpenVera y el lenguaje Ede Verisity, impulsaron el desarrollo de Superlog, por Co-Design Automation Inc. Co-Design fue más tarde comprada por Synopsis. Las bases de Superlog y Vera han sido donadas a Accellera. Todo ello ha sido transformado y actualizado en forma de SystemVerilog, que probablemente se convierta en el próximo estándar de la IEEE.
El grupo trabajador de IEEE, liberó al público el Standard revisado enMarzo del 2002 conocido como IEEE 1364-200. Esta versión tuvo muchos errores los cuales fueron revisados y corregidos en la versión del 2003, conocida en la IEEE 1364-2001 revisión C.
Subsecuentemente, un Nuevo grupo de trabajadores se formó, IEE P1800, para construir el lenguaje 1364 IEEE con la contribución adicional de Accellera. A mediados del 2004 el comité IEEE 1364 desaparece y se...
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