Procesador mono-ciclo de 32 bits

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ARQUITECTURA DE COMPUTADORAS.

PRÁCTICA:

“SIMULACIÓN DE UN PROCESADOR MONO-CICLO DE 32 BITS”

10 de Febrero de 2008.

Introducción.

El rendimiento de una maquina se puede medirdependiendo de tres factores importantes, que son los ciclos de reloj por instrucción, el repertorio de instrucciones y el tamaño del ciclo de reloj, para esto se va a simular un procesador mono-ciclo de 32bits, para ver el funcionamiento de un procesador real en función del que se va a simular.
Se pretende realizar la implementación del programa de simulación de un procesador mono-ciclo de 32 bits,utilizando el programa Active-HDL 6.2, y los temas vistos en clases, cada avance será de gran ayuda para ir entendiendo lentamente el funcionamiento de un procesador, desde los bloques que lo conformanhasta el sistema completo; se harán bloques individuales para cada función que se quiera hacer en el sistema, esto para hacer mas simple el funcionamiento y así no perder el orden en el que se programarael sistema.
Las partes que conforman el sistema, son los que se muestran en la figura 1, mas las partes agregadas para el uso de saltos j, bne, y jump, el sistema final se muestra en la figura 2.Cada bloque parte del sistema será un archivo independiente, que podrá ser simulado individualmente, los bloque que forman dicho sistema esta conformado por sumadores, diferentes multiplexores, ALU de32 bits, y algunos otros bloque sencillos individuales.

Objetivo
Simular con ayuda del Active-HDL una implementación de un solo ciclo de reloj de una arquitectura RISC de 32 bits que soporte lasinstrucciones siguientes:

Tabla 1. Requerimiento de la implementación de un solo ciclo de reloj.
[pic]

Procedimiento.
A partir del esquema de la figura 1, y los temas vistos en clase, sepretende aumentar dicho esquema en los módulos que sean necesarios para que el diseño pueda soportar las instrucciones de la Tabla 1.
Una vez que se tuvo dicho esquema se procedió a programar las...
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